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EDA技术实用教程_潘松_黄继业_课后答案

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发表于 2016-12-14 13:27:58 | 显示全部楼层 |阅读模式
给出一个41多路选择器的VHDL描述。选通控制端有四个输入:S0S1S2S3。当且仅当S0=0:Y=AS1=0:Y=BS2=0:Y=CS3=0:Y=D
--解:41多路选择器VHDL程序设计。
    LIBRARY  IEEE;
    USE IEEE.STD_LOGIC_1164.ALL;
    ENTITY mux41a IS
      PORT(    A,B,C,D :  IN STD_LOGIC;
           S0,S1,S2,S3 :  IN STD_LOGIC;
                     Y : OUT STD_LOGIC);
    END ENTITY mux41a;
    ARCHITECTURE one OF mux41a IS
      SIGNAL S0_3 : STD_LOGIC_VECTOR(3 DOWNTO 0);
    BEGIN
      S0_3<=S0&S1&S2&S3;
      y<=A  WHEN S0_3="0111" ELSE
         B  WHEN S0_3="1011" ELSE
         C  WHEN S0_3="1101" ELSE
         D  WHEN S0_3="1110" ELSE
         'Z';
    END ARCHITECTURE one;

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发表于 2018-4-23 20:03:24 | 显示全部楼层

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发表于 2018-5-29 19:13:14 | 显示全部楼层
。。。
。。。。。。。。。。。。。

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发表于 2018-6-20 19:11:49 | 显示全部楼层
大叔大婶啊

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小学生

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发表于 2018-6-20 19:12:48 | 显示全部楼层
试试看吧????

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发表于 2018-11-28 21:35:06 | 显示全部楼层
非常感谢楼主分享奥尼,再次致以诚挚的感谢

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发表于 2019-3-18 09:22:20 | 显示全部楼层
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发表于 2019-3-19 21:35:36 | 显示全部楼层
非常感谢楼主,帮了大忙

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发表于 2019-4-22 15:28:49 | 显示全部楼层
啊啊啊啊啊啊啊啊啊

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幼儿园

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发表于 2019-5-24 15:37:01 | 显示全部楼层
优秀,干啊就从积极的
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